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VHDL語言及其在實際電路設(shè)計中的簡化問題

發(fā)布時間：2012-10-8 16:16    發(fā)布者：newlife
關(guān)鍵詞： VHDL
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rinllow6 發(fā)表于 2012-10-9 14:00:38
SystemVerilog專輯，十幾本
jinlei_57 發(fā)表于 2012-10-12 01:58:24
謝謝!
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