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基于Verilog_HDL的全功能UART_IP核的設計與實現

發布時間：2012-10-8 16:20 發布者：newlife

關鍵詞： Verilog , HDL

基于Verilog_HDL的全功能UART_IP核的設計與實現下載：基于Verilog_HDL的全功能UART_IP核的設計與實現.pdf

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網友評論

rinllow6 發表于 2012-10-9 23:40:30

謝謝!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!

culcrum 發表于 2012-10-18 00:21:21

正在學習這個，感謝！

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