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FPGA/CPLD資料下載列表

基于FPGA至簡(jiǎn)設(shè)計(jì)法的4位閃爍燈 附件更詳細(xì)

4位閃爍燈一、項(xiàng)目背景LED燈的理論、教學(xué)板的原理圖,已經(jīng)在案例1位閃爍燈中有詳細(xì)的描述,在此不再講述,有興趣的讀者可以返回去閱讀。 二 ...
2018年09月26日 09:56

【時(shí)序約束資料包】培訓(xùn)課程Timing VIVADO

好的時(shí)序是設(shè)計(jì)出來(lái)的,不是約束出來(lái)的時(shí)序就是一種關(guān)系,這種關(guān)系的基本概念有哪些?這種關(guān)系需要約束嗎?各自的詳細(xì)情況有哪些?約束的方 ...
2018年08月01日 18:28   |  
FPGA  

FPGA至簡(jiǎn)設(shè)計(jì)法為什么這么簡(jiǎn)單

由潘文明先生開(kāi)創(chuàng)的IC/FPGA至簡(jiǎn)設(shè)計(jì)法,具備劃時(shí)代的意義。這種設(shè)計(jì)方法不僅將IC/FPGA學(xué)習(xí)難度降到了最低,同時(shí)將設(shè)計(jì)過(guò)程變得簡(jiǎn)單,并規(guī)范 ...
2017年12月15日 15:34   |  
altera   至簡(jiǎn)設(shè)計(jì)法   FPGA   計(jì)數(shù)器  

FPGA模塊劃分技巧

學(xué)習(xí)至簡(jiǎn)設(shè)計(jì)法,學(xué)會(huì)模塊設(shè)計(jì)和模塊劃分技巧。模塊劃分技巧非常重要,好的模塊結(jié)構(gòu),能極大地精簡(jiǎn)各模塊的結(jié)構(gòu),從而能用最少的代碼實(shí)現(xiàn)所 ...
2017年12月04日 16:44   |  
FPGA   verliog   altera   Xilinx  

明德?lián)PFPGA設(shè)計(jì)技巧--gVim模板分享2

要使用上面快捷命令,需要明德?lián)P的配置文件,歡迎關(guān)注明德?lián)P公眾號(hào)“fpga520”,或群544453837索取。口號(hào):多用模板,減少記憶,專注設(shè)計(jì)! ...
2017年11月29日 15:48   |  
xilinx   altera   gVim   FPGA   明德?lián)P  

基于FPGA的verilog萬(wàn)年歷程序_萬(wàn)年歷設(shè)計(jì)_明德?lián)P資料

工程說(shuō)明在FPGA設(shè)計(jì)中,數(shù)字萬(wàn)年歷屬于小規(guī)模集成電路。從原理上來(lái)講,是典型的數(shù)字電路,包括組合邏輯電路和時(shí)序電路。基于FPGA開(kāi)發(fā)除設(shè)計(jì) ...

基于CPLD/FPGA的呼吸燈效果實(shí)現(xiàn)_呼吸燈源碼_明德?lián)P資料

工程說(shuō)明本模塊的功能要求是,實(shí)現(xiàn)8個(gè)燈前1s慢慢變暗,后1s慢慢變亮,不斷重復(fù)以上操作。 案例補(bǔ)充說(shuō)明呼吸燈效果的LED每時(shí)每刻都在以不同 ...
2017年08月02日 17:08   |  
fpga呼吸燈   呼吸燈verilog源碼   呼吸燈源碼   呼吸燈程序  

fpga鬧鐘程序_fpga時(shí)鐘模塊應(yīng)用_明德?lián)P資料

工程說(shuō)明本工程包括矩陣鍵盤(pán)和數(shù)碼管顯示模塊,共同實(shí)現(xiàn)一個(gè)帶有鬧鐘功能、可設(shè)置時(shí)間的數(shù)字時(shí)鐘。 案例補(bǔ)充說(shuō)明我們通過(guò)建立四個(gè)清晰直觀 ...

基于FPGA的籃球倒計(jì)時(shí)的設(shè)計(jì)和實(shí)現(xiàn)_FPGA倒計(jì)時(shí)模塊應(yīng)用_明德?lián)P資料

工程說(shuō)明本項(xiàng)目包含2個(gè)按鍵和4位數(shù)碼管顯示,要求共同實(shí)現(xiàn)一個(gè)籃球24秒的倒計(jì)時(shí),并具有暫停和重新計(jì)數(shù)復(fù)位的功能。案例補(bǔ)充說(shuō)明與單片機(jī)等 ...

FPGA-Verilog學(xué)習(xí)之紅外接收解碼_紅外接收源碼_明德?lián)P資料

工程說(shuō)明本案例實(shí)現(xiàn)了編碼格式為“引導(dǎo)碼+地址碼+數(shù)據(jù)碼+數(shù)據(jù)反碼”的紅外發(fā)送數(shù)據(jù)進(jìn)行接收和解碼,并將收到的數(shù)據(jù)顯示到七段譯碼器上。案 ...
2017年08月02日 16:50   |  
fpga   verilog   紅外源碼   紅外解碼學(xué)習(xí)   紅外解碼資料  

按鍵消抖的原理和基于fpga的消抖設(shè)計(jì)_明德?lián)P資料

工程說(shuō)明在系統(tǒng)設(shè)計(jì)中,消除按鍵抖動(dòng)的方法五花八門(mén),無(wú)論是硬件電路和軟件設(shè)計(jì)都十分成熟。在本項(xiàng)目中,我們將用Verilog語(yǔ)言給出具體實(shí)現(xiàn) ...
2017年08月02日 16:45

基于FPGA的VGA顯示矩形框_VGA接口設(shè)計(jì)_VGA信號(hào)處理_明德?lián)P資料

工程說(shuō)明本工程VGA顯示要求:在顯示屏邊緣上顯示一個(gè)紅色邊框(邊框?qū)挒?0像素),在屏幕的中央顯示一個(gè)綠色矩形(矩形長(zhǎng)為150像素,高為10 ...
2017年08月02日 16:30   |  
VGA   VGA設(shè)計(jì)   VGA接口   VGA圖像處理  

FTR濾波器_濾波器原理_有限脈沖響應(yīng)濾波器_明德?lián)Pfpga

工程說(shuō)明本案例設(shè)計(jì)了一個(gè)15階的低通線性相位FIR濾波器,采用布萊克曼窗函數(shù)設(shè)計(jì),截止頻率為500HZ,采樣頻率為2000HZ;實(shí)現(xiàn)全串行結(jié)構(gòu)的濾 ...

FFT至簡(jiǎn)設(shè)計(jì)法實(shí)現(xiàn)法_FFT算法_蝶形運(yùn)算_fpga

工程說(shuō)明本設(shè)計(jì)討論的是基于至簡(jiǎn)設(shè)計(jì)法實(shí)現(xiàn)按時(shí)間抽選的基2-FFT算法(即DIF-FFT)實(shí)現(xiàn)過(guò)程,支持N由8到1024。 案例補(bǔ)充說(shuō)明本案例無(wú)論是模 ...
2017年08月02日 16:10   |  
FFT設(shè)計(jì)   FFT算法   蝶形運(yùn)算   fpga   嵌入式  

Verilog 編寫(xiě)的基于VGA的動(dòng)畫(huà)圖像顯示_fpga的VGA接口設(shè)計(jì)_明德?lián)P資料

工程說(shuō)明本工程VGA顯示要求:復(fù)位后,屏幕中央顯示直徑為10的藍(lán)色圓點(diǎn);按下按鍵0,圓點(diǎn)圖像逐漸變大,直至直徑變?yōu)?00;再按一下按鍵0,圓 ...

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